CXLがOpenCAPIを吸収し相互接続の優位性を目指す

Compute Express Link (CXL) は、競合する OpenCAPI 仕様策定の取り組みを吸収し、CPU をデバイスや分散メモリにリンクするための標準的な高性能相互接続となる予定です。

CXL は当初 Intel によって開発され、標準規格を推進するために 2019 年に CXL コンソーシアムが設立されて以来、幅広い業界関係者から支持を集めています。

一方、OpenCAPI は、IBM がアクセラレータを Power プロセッサに接続するために開発したテクノロジに基づいており、OpenCAPI コンソーシアム (OCC) は、この標準を Power チップ以外にも広めるために 2016 年に結成され、たとえば AMD の Epyc サーバ ポートフォリオにも採用されています。

現在、OpenCAPI コンソーシアムは CXL コンソーシアムとの契約を締結したことを発表しました。この契約がすべての関係者によって承認されれば、OpenCAPI および OMI 仕様を含むすべての OpenCAPI コンソーシアム資産が CXL コンソーシアムに移管されます。

OMI (Open Memory Interface) は、低レイテンシのメモリ操作をサポートする OpenCAPI の拡張機能です。

これはCXLが吸収合併した最初のライバルではない。同社は今年初め、ストレージクラスのメモリ技術をCPUに接続する目的で設計されたGen-Zインターコネクトに関する仕様と資産の譲渡を受け入れる契約をGen-Zコンソーシアムと締結した。

この合意により、Gen-Zは事実上存在しなくなり、その技術はCXLに統合されました。OpenCAPIの吸収によって、この動きが繰り返される可能性が高いでしょう。これは必ずしも悪いことではありません。業界が競合する技術ではなく、単一の相互接続で標準化できることを意味するからです。

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CXLコンソーシアムのシアマク・タヴァラエイ会長は、これは業界を一つの組織のもとで仕様に集中させる機会であると語った。

「OCC資産の譲渡により、CXLコンソーシアムはOCCがOpenCAPI/OMIですでに開発したものを自由に利用できるようになります」とタヴァラエイ氏は述べた。

CXL は、物理的および電気的インターフェースとして PCIe 5.0 標準に基づいて構築されており、CXL 2.0 によりサーバーが他のノード内にあるアクセラレータやメモリなどのリソースに接続できるようになるため、データセンターに新しいアーキテクチャの選択肢が広がります。

最初の CXL 互換システムは、Intel の Sapphire Rapids Xeon Scalable プロセッサと AMD の Genoa 第 4 世代 Epyc チップの搭載により、今年後半に発売される予定です。

これらを見越して、メモリおよびストレージメーカーのSK hynixは今週、初のDDR5 DRAMベースのCXLメモリモジュールを発表し、2023年までにCXLメモリ製品の量産を目指すと発表した。

DIMMではなく、ドライブに一般的に使用されるEDSFF（エンタープライズ＆データセンター標準フォームファクター）エンクロージャに収められています。SK hynix製24GB DDR5 DRAMコンポーネントを搭載した96GBの製品で、PCIe 5.0 x8インターフェースで外部と接続します。

SK hynix は、初の CXL メモリ製品の発売日を明かさなかったが、Samsung は 5 月に独自の 512GB CXL DRAM 製品を発表しており、今年の第 3 四半期に評価とテストが開始され、それをサポートする次世代サーバー プラットフォームが利用可能になり次第、商品化される予定である。®