予想よりやや遅れましたが、Peripheral Component Interconnect Special Interest Group (PCI-SIG) は、パーソナル コンピュータやサーバーの PCI Express I/O バスを介してデバイスを接続するための技術要件を規定した PCIe 4.0 仕様をようやくリリースしました。
「PCIe 4.0仕様が業界に提供されることは、柔軟なレーン幅構成で16GT/sの高性能データレートを提供しながら、低消費電力に対する業界の要件を継続的に満たすため、当社の仕様ライブラリへの重要な追加となります」と業界コンソーシアムの会長兼社長であるアル・ヤネス氏はブログ投稿で述べた。
2011 年に初めて発表されたバージョン 4.0 では、2010 年に発表された PCIe 3.0 で利用可能なデータ転送速度が 2 倍になっています。レーン マージン (製品エンジニアが特定のシステムで利用可能な電気的マージンを評価できるようにする)、低レイテンシ、RAS 機能 (信頼性、可用性、保守性)、より堅牢な I/O 仮想化とプラットフォーム統合などの改善が含まれています。
PCIe 4.0とPCI 3.0の間に7年間のギャップがあったため、他のデータ転送方式が勢いづいたようです。CCIX（Cache Coherent Interconnect for Accelerators）には、AMD、ARM、Broadcom、IBM、Micron、Qualcomm、Red Hat、Texas Instruments、Xilinxなどの企業が加盟しています。
サーバーに重点を置くコンソーシアムは8月に、現在の標準であるPCIe 3.0の3倍、PCIe 4.0よりも高速な25Gbpsの速度でデータを転送することに成功したと発表した。
相互接続
この速度は、別の相互接続グループである OpenCAPI が達成できると主張する速度とほぼ同じです。
PCI-SIGは、提供スケジュールの加速化により、会員企業に追い抜かれる事態を回避できる可能性があります。6月に発表され、32GT/sに対応するPCIe 5.0は、2年足らず、2019年第2四半期にリリースされる予定です。
PCIe速度は2019年までに倍増し128GB/秒に
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PCI Express のデータ転送速度がさらに 2 倍になると、大量のデータが I/O チャネルを介して転送される機械学習、ゲーム、画像処理などのさまざまな最新のワークロードに潜在的なメリットがもたらされます。
「PCI-SIGは、仕様策定プロセスを改善し、レビューサイクルを最小化することで遅延を削減し、5.0のタイムラインを加速させることができました」と、ヤネス氏はThe Registerへのメールで説明した。「私たちは、会員の皆様が求めるスケジュールで仕様を提供することに注力しています。」
ヤネス氏によると、プロセスの変更点の 1 つは、仕様の以前のバージョンのレビューを簡素化および合理化することです。
「さらに、シリコン設計プロセスの改善、主要な機能強化、PCIe 4.0仕様で規定された将来を見据えたアーキテクチャ設計のおかげで、PCIe 5.0仕様のフレームワークがすでに整備されていたため、タイムラインを加速することができました」と氏は述べた。
Yanes 氏は、プロトコルの改善、レーン マージン、16GT/s のサポートなど、3.0 から 4.0 への移行におけるいくつかの課題を挙げています。
ヤネス氏によると、バージョン5.0では、変更は主に速度向上に限定されるという。「PCIeプロトコルは既に拡張タグとクレジットによって高速化をサポートしており、業界の既存のPHYは既に28GHz/56GHzで動作しています。PCIe 5.0では、業界の既存技術を活用し、Megtron 6のような新素材や新しいコネクタも検討する必要があります」とヤネス氏は述べた。
今年出荷が予定されているIBMのPOWER9プロセッサは、PCIe 4.0を搭載した最初のプロセッサと言われています。Intelは先月、PCIe 4.0インターフェースを搭載した10nmプロセスFalcon Mesa FPGAを発表しました。
さらに多くのキットが続くはずですが、5.0 が間近に迫っているため、長期的な関係は期待しないでください。®
